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usb2.0的IP核,可在QuartusII或MaxPlusII环境下实现编译和生成ip核
USB2.0 IP核,ASIC,FPGA可用,Verilog HDL源代码
经过门级网单验证的USB2.0 IP核 RTL代码
完整的用VERILOG语言开发的USB2.0 IP核源代码,包括文档、仿真文件
ip核,蓝牙bluetooth的fpga硬件实现
usb1.1 ip核,使用verilog编写
ADC IP核用于在Nios II系统中实现AD数据采集接口,包含完整设计与实现方案,适用于嵌入式系统开发与信号处理应用。
DDR3高速IP控制核,里面包括仿真、IP示例程序,实现乒乓FIFO操作
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